論文誌
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H. Ochi, K. Yamaguchi, T. Fujimoto, J. Hotate, T. Kishimoto, T. Higashi, T. Imagawa, R. Doi, M. Tada, T. Sugibayashi, W. Takahashi, K. Wakabayashi, H. Onodera, Y. Mitsuyama, J. Yu, M. Hashimoto
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Via-Switch FPGA: Highly-Dense Mixed-Grained Reconfigurable Architecture with Overlay Via-Switch Crossbars
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IEEE Transactions on VLSI Systems
| 26(12)
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2723--2736
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2018年12月
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| pdf
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論文誌
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M. Hashimoto, J. Yamaguchi, T. Sato, H. Onodera
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Timing Analysis Considering Temporal Supply Voltage Fluctuation
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IEICE Trans. on Information and Systems
| E91-D(3)
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655--660
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2008年3月
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| 101.pdf
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論文誌
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M. Hashimoto, J. Yamaguchi, H. Onodera
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Timing Analysis Considering Spatial Power/Ground Level Variation
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IEICE Trans. on Fundamentals of Electronics, Communications and Computer Sciences
| E90-A(12)
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2661-2668
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2007年12月
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| 95.pdf
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国際会議
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M. Hashimoto, J. Yamaguchi, T. Sato, H. Onodera
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Timing Analysis Considering Temporal Supply Voltage Fluctuation
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Proceedings of Asia and South Pacific Design Automation Conference (ASP-DAC)
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1098-1101
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2005年1月
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| 32.pdf
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国際会議
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M. Hashimoto, J. Yamaguchi, H. Onodera
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Timing Analysis Considering Spatial Power/Ground Level Variation
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Proceedings of ACM/IEEE International Conference on Computer-Aided Design (ICCAD)
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814-820
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2004年11月
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| 41.pdf
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国内会議(査読付き)
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山口 隼司, 橋本 昌宜, 小野寺 秀俊
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IRドロップを考慮した電源線構造の最適化手法
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情報処理学会DAシンポジウム
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253-258
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2002年7月
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研究会・全国大会等
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山口隼司, 橋本昌宜, 小野寺秀俊
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ゲート毎の電源電圧変動を考慮した静的遅延解析法
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電子情報通信学会 VLSI設計技術研究会
| (ICD2003-236/VLD2003-143)
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2004年3月
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