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	著者名 (author)	表題 (title)	論文誌/会議名	巻号	ページ範囲 (pages)	出版年月	JCR/採択率	File
論文誌	C.-C. Hsu, M. Hashimoto, P.-H. Lin	Latch Clustering for Minimizing Detection-To-Boosting Latency Toward Low-Power Resilient Circuits	Integration, the VLSI Journal	58	236--244	2017年6月		233.pdf
国際会議	C.-C. Hsu, M. P.-H. Lin, M. Hashimoto	Latch Clustering for Minimizing Detection-To-Boosting Latency Toward Low-Power Resilient Circuits	Proceedings of System Level Interconnect Prediction (SLIP) Workshop			2016年6月		229.pdf