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国内会議(査読付き)

[1] 土井龍太郎, 劉載勲, 橋本昌宜, "ビアスイッチFPGAの部分的再構成における書き換えスイッチ数の最小化," 情報処理学会DAシンポジウム, 2019年8月.

[2] 土井龍太郎, 劉載勲, 橋本昌宜, "ビアスイッチFPGA再構成時のスニークパス問題を回避するプログラミング順決定手法," 情報処理学会DAシンポジウム, 2018年8月.

[3] 土井龍太郎, 橋本昌宜, "ビアスイッチFPGAにおけるスニークパス問題のSAT符号化を用いた検証," 情報処理学会DAシンポジウム, 2017年8月.

研究会・全国大会等

[1] 中澤祐希, 土井龍太郎, 劉載勲, 橋本昌宜, "ビアスイッチFPGA向け配線遅延解析手法の検討," 電子情報通信学会 VLSI設計技術研究会, number VLD2017-120, 2018年3月.

[2] 土井龍太郎, 橋本昌宜, 尾上孝雄, "時間的三重化によるソフトエラー耐性向上の解析的評価," 電子情報通信学会ディペンダブルコンピューティング研究会, 2014年11月.